デジタル・デザインとインターコネクト規格

Agilentによる最高のデザインの支援。高速規格に対応し、お客様の高速デジタル・デザイン・サイクル（デザイン／シミュレーション／解析／デバッグ／コンプライアンス／シグナル・インテグリティ）に適合する、最適なソリューションをご検討いただけます。

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* AMF2013 - 7月開催 / トレーニング・コース一覧アジレント電子計測　有料トレーニングコース一覧トレーニング資料 2013-05-07
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PCI Express® 3.0/2.0デザインでの物理層のデザインの課題最新のPCIe 3.0仕様の要件およびPCIe 2.0/1.1デザインへの実用的な拡張に対応した、PCI Express物理層の検証の高度な技術を学習することができます。本セミナーは、トランスミッタ／レシーバ性能を解説しています。ウェブセミナ（録画）
PCI Express® 3.0の問題とAgilentのテスト・ソリューション　ウェブセミナ（録画）
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PCIe 3.0レシーバ・テスト：新たな課題への対処方法(英語版) PCIe 3.0が登場したとき、既存のパッシブ・インフラストラクチャ（チャネル）の再利用が最終目標でした。信号速度（8 Gb/s対5 Gb/s）が2倍近く高速になった今、エラーのない伝送は、RXに大きく左右されます。しかし、規範的... ウェブセミナ（録画）
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高速デジタル設計を成功に導く、ADS、EMPro、SystemVue ワークショップ資料このセルフガイド・ワークショップの資料は、ADS 2011の最新の高速デジタル機能を紹介しています。セミナのプレゼンテーション 2011-09-29
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Analyzing Digital Jitter and its Component eSeminar FAQs FAQs from the eSeminar セミナのプレゼンテーション 2006-05-11	PDF 35 KB
Application-focused Oscilloscope Measurements – Education Webcast Series Live broadcasts throughout 2013 ウェブセミナ
Astonishing Enhancements to Signal Integrity EDA Tools Using Video Game 3D Glasses and GPUs Originally broadcast Jan 21, 2010 ウェブセミナ（録画）
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Building a Precision Jitter Source Presentation, June 1, 2004 From the Japan Agilent Digital Measurement Forum, this presentation reviews the construction of a precision jitter source for analyzing digital jitter measurements. セミナのプレゼンテーション 2004-06-01	PDF 623 KB
Case Study: Overcoming Return-path Discontinuity in DDR3/GDDR5 Memory Controller Packages Original broadcast October 13, 2011 ウェブセミナ（録画）
Characterization and Modeling of a High Speed Backplane Differential Channels eSeminar FAQs FAQs from the eSeminar セミナのプレゼンテーション 2006-05-11	PDF 80 KB
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